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Verificador de un sistema de procesado de señales de radar SMR basado en FPGA's

Datos Generales

Nombre del Proyecto:

Verificador de un sistema de procesado de señales de radar SMR basado en FPGA's

Acrónimo:

RADARSMR

Tipo de proyecto:

Privado

Referencia:

Artículo 83 LOU

Entidad financiadora:

INDRA Sistemas S.A.

Fecha de inicio:

1 Jun 2009

Fecha de finalización:

1 Jul 2009

Participantes

Investigador Principal:

joseluis.lazaro

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